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成都回流焊爐回收LED封裝測試設(shè)備回收 SMT貼片機(jī)設(shè)備回收
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產(chǎn)品描述

回收價(jià)格電議 機(jī)器成色現(xiàn)場機(jī)器為準(zhǔn) 交易方式上門回收 付款方式現(xiàn)金轉(zhuǎn)賬 工作時(shí)間24小時(shí)
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自動(dòng)化編程(AP)設(shè)備
PIC技術(shù)不斷地向前發(fā)展,所以新的自動(dòng)化編程設(shè)備和技術(shù)也保持著相同的發(fā)展步伐。舉例來說,Data I/O''s ProMaster 970自動(dòng)化微細(xì)間距編程設(shè)備能夠?qū)Σ捎梅庋b形式的PIC器件進(jìn)行編程,其中包括BGA、微型BGA、SOP、VSOP、TSOP、PLCC、SON和CSP。雙重貼裝(Dual pick-and-place簡稱PNP) 端頭和可供選擇的可插8、10或者12的插座可以的提高設(shè)備的工作效率。該編程設(shè)備也可以進(jìn)一步涉及有關(guān)器件的質(zhì)量控制。舉例來說,共平面性問題和引腳的損傷實(shí)際上是不會(huì)存在的,因?yàn)榧闪思す庖曈X系統(tǒng),所以能夠確保非常的器件貼裝。
因?yàn)橛兄喾N編程接口和PNP器件的配置,自動(dòng)集群編程一般可以做到比ATE編程的速度快上5倍到10倍。同樣,這些編程工具是為了編程而設(shè)計(jì)的,不是為了對(duì)電路板或者說功能進(jìn)行測試的,所以它們可以提供非常好的編程質(zhì)量。
微細(xì)間距的PIC器件可能是非常貴的,所以如果能降低其在生產(chǎn)制造過程中的損傷率,將極大的提升制造商的盈虧平衡點(diǎn)。能夠適用于大多數(shù)元器的自動(dòng)編程系統(tǒng)也是非常靈活的,可以適應(yīng)于封裝器件形式。由于能夠?qū)⒏呱a(chǎn)率、高質(zhì)量和靈活性綜合在一起,導(dǎo)致了每個(gè)器件可得到的編程價(jià)格常常低于ATE編程價(jià)格的20%。
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貼片機(jī)行業(yè)背景
對(duì)于PIC器件來說,以往普遍采用DIP、PLCC或者SOIC的封裝形式。然而,隨著人們對(duì)緊湊型、高性能產(chǎn)品的需求增加,要求引入更為的PIC器件?,F(xiàn)如今的閃存器件可以采用SOP、TSOP、VSOP、BGA和微小型BGA封裝形式。高性能的微型控制器、CPLD器件和FPGA器件一直到可以采用QFP、BGA和微型BGA封裝形式,其所擁有的引腳數(shù)量范圍從44條一直可以達(dá)到超過800條以上。
由于非常多的引腳數(shù)量和很小的外形尺寸,這些元器件中的大部分僅能夠采用微細(xì)間距的封裝形式。微細(xì)間距的元器件所擁有的引腳非常脆弱,間距只有0.508(20 mils)或者說間隙幾乎沒有。這樣人們就將目光瞄向了使用PIC器件來應(yīng)對(duì)這一挑戰(zhàn)。 具有高密度和高性能的PIC器件價(jià)格是很昂貴的,要求采用高質(zhì)量的編程設(shè)備,需要擁有非常優(yōu)異的過程控制,以求將元器件的廢棄程度降低到小的程度。
在采用手工編制程序的操作過程中,微細(xì)間距元器件實(shí)際上肯定會(huì)遭遇到來自共面性和其它形式的引腳損傷因素的威脅。如果說引腳受到了損傷的話,那么將可能導(dǎo)致焊接點(diǎn)可靠性出現(xiàn)問題,會(huì)提升生產(chǎn)制造過程中的缺陷率。同樣,高密度的元器件實(shí)際上將花費(fèi)較長的編程時(shí)間,這樣就會(huì)降低生產(chǎn)的效率。
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選擇編程的策略
生產(chǎn)部門的負(fù)責(zé)人常常會(huì)考慮采用編程的不同方式,他們會(huì)問:“采用何種編程方式對(duì)我來說是適合的呢?”沒有一種可以滿足所有的應(yīng)用事例的。他們權(quán)衡的內(nèi)容一般會(huì)包含有:所采用的解決方案對(duì)生產(chǎn)效率、生產(chǎn)線使用的計(jì)劃安排、PCB的價(jià)格、工藝控制問題、缺陷率水平、供應(yīng)商的管理、主要設(shè)備的成本以及存貨的管理是否會(huì)帶來沖擊。
對(duì)生產(chǎn)效率帶來的沖擊
ATE編程會(huì)降低生產(chǎn)效率,這是因?yàn)闉榱四軌驖M足編程的需要,要增加額外的時(shí)間。舉例來說,如果為了檢查制造過程中所出現(xiàn)的缺陷現(xiàn)象,需要花費(fèi)15秒的時(shí)間進(jìn)行測試,這時(shí)可能需要再增加5秒鐘用來對(duì)該元器件進(jìn)行編程。ATE所起到的作用就像是一臺(tái)非常昂貴的單口編程器。同樣,對(duì)于需要花費(fèi)較長時(shí)間編程的高密度閃存器件和邏輯器件來說,所需要的總的測試時(shí)間將會(huì)更長,這令人。因此,當(dāng)編程時(shí)間與電路板總的測試時(shí)間相比較所占時(shí)間非常小的時(shí)候,ATE編程方式是性價(jià)比一種方式。為了提高生產(chǎn)率,以求將較長的編程時(shí)間降低到的限度,ATE編程技術(shù)可以與板上技術(shù)相結(jié)合使用,例如:邊界掃描或者說具有專利的眾多方法中的一種。
還有一種解決方案是在電路板進(jìn)行測試的時(shí)候,僅對(duì)目標(biāo)器件的boot碼進(jìn)行編程處理。器件余下的編程工作在處于不影響生產(chǎn)率的時(shí)候才進(jìn)行,一般來說是在設(shè)備進(jìn)行功能測試的時(shí)候。然而,除非超過了ATE的能力,功能測試的能力是足夠的,對(duì)于高密度器件來說性能價(jià)格比編程方法是一種自動(dòng)化的編程設(shè)備。舉例來說:ProMaster 970設(shè)備配置有12個(gè)接口,每小時(shí)能夠?qū)?00個(gè)8兆閃存進(jìn)行編程和激光標(biāo)識(shí)。與此形成對(duì)照的是,ATE或者說功能測試儀將花費(fèi)60至120小時(shí)來完成這些編程工作。
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IEEE 1149.1邊界掃描編程
為了提升PCB組件的密度和復(fù)雜性,使電路板和元器件的測試工作面臨著非常大的困難,尤其是對(duì)付空間受到限制的PCB組件。為了能夠有效的解決這一問題,一種邊界掃描測試協(xié)議(IEEE 1149.1)應(yīng)運(yùn)而生。
IEEE 1149.1測試標(biāo)準(zhǔn)能夠通過一臺(tái)智能化外部設(shè)備,對(duì)在組裝的電路板上的邏輯器件或者閃存器件進(jìn)行編程。這種編程設(shè)備通過標(biāo)準(zhǔn)的測試訪問口(Test Access Port 簡稱TAP)與電路板形成連接界面。所有這些需要采用JTAG硬件控制裝置、JTAG軟件系統(tǒng)、與JTAG兼容的PCB電路板,和一個(gè)四線測試訪問口。
實(shí)現(xiàn)邊界掃描工作可以采用一種化的電路板上編程設(shè)備,或者采用另外一種選擇方案,利用由美國GenRad、Hewlett-Packard和Teradyne ATE testers等公司提供的一些工具,于是可以在ATE測試設(shè)備上實(shí)現(xiàn)IEEE 1149.1邊界掃描編程工作。
采用IEEE標(biāo)準(zhǔn)的優(yōu)點(diǎn)就在于,它可以對(duì)在同一塊PCB上由不同供應(yīng)商提供的各種各樣的元器件進(jìn)行編程。這樣就可以降低整個(gè)編程時(shí)間,簡化生產(chǎn)制造流程。
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產(chǎn)品推薦

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