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IEEE1149.1定義了一個掃描器件的幾個重要特性。先定義了組成測試訪問端口（TAP）的四（五〕個管腳：TDI、TDO、TCK、TMS，（TRST）。測試方式選擇（TMS）用來加載控制信息；其次定義了由TAP控制器支持的幾種不同測試模式，主要有外測試（EXTEST）、內(nèi)測試（INTEST）、運行測試（RUNTEST）；提出了邊界掃描語言（Boundary Scan Description Language），BSDL語言描述掃描器件的重要信息，它定義管腳為輸入、輸出和雙向類型，定義了TAP的模式和指令集。
具有邊界掃描的器件的每個引腳都和一個串行移位寄存器（SSR）的單元相接，稱為掃描單元，掃描單元連在一起構(gòu)成一個移位寄存器鏈，用來控制和檢測器件引腳。其特定的四個管腳用來完成測試任務(wù)。
將多個掃描器件的掃描鏈通過他們的TAP連在一起就形成一個連續(xù)的邊界寄存器鏈，在鏈頭加TAP信號就可控制和檢測所有與鏈相連器件的管腳。這樣的虛擬接觸代替了針床夾具對器件每個管腳的物理接觸，虛擬訪問代替實際物理訪問，去掉大量的占用PCB板空間的測試焊盤，減少了PCB和夾具的制造費用。
作為一種測試策略，在對PCB板進行可測性設(shè)計時，可利用軟件分析電路網(wǎng)點和具掃描功能的器件，決定怎樣有效地放有限數(shù)量的測試點，而又不減低測試覆蓋率，經(jīng)濟的減少測試點和測試針。

通常，這類器件的判定標(biāo)準(zhǔn)可以通過對毛細(xì)效應(yīng)在垂 直方向的作用的分析中找到。由于毛細(xì)力，焊錫從焊盤末端 爬到引腳上形成焊點。由于工藝波動和器件邊緣的阻擋作 用，導(dǎo)致不能完全形成一個完整的上半月型焊點。盡管沒有 形成一個上半月型的焊點，但也可以被認(rèn)為焊接得很好。 “鷗翼”型引腳焊錫的側(cè)面爬升情況由于器件變化或 焊盤設(shè)計的原因，并不是經(jīng)常能夠被檢查出來，這是由于 焊錫的爬升方向必須用同引腳方向垂直的角度去檢查。假 如爬升很小，必須從其他角度來檢查，而只有通過這樣的檢查，才能提供豐富的圖像信息去評估焊點的好壞。
斜角檢測：PLCCs型器件
PLCCs器件的引腳的焊盤有著不同設(shè)計。如果是一個 長焊盤設(shè)計，在PLCC引腳上焊錫的爬升效果是可以檢查 的。如果焊盤保持明亮，那么焊錫已經(jīng)爬升到了引腳端， 所以認(rèn)為器件是焊上了。假如遵循這個設(shè)計原則，可以通過垂直檢測來檢查出缺陷。
對于PLCC焊點，有時會出現(xiàn)少錫的情況。由于引腳少 錫的爬升情況和沒有焊錫時是一樣的，所以對PLCC焊點不 能通過垂直檢測，而要通過斜角檢測的方式來檢查少錫缺陷。

AOI（Automated Optical Inspection縮寫）的中文全稱是自動光學(xué)檢測，是基于光學(xué)原理來對焊接生產(chǎn)中遇到的常見缺陷進行檢測的設(shè)備。AOI是新興起的一種新型測試技術(shù)，但發(fā)展迅速，很多廠家都推出了AOI測試設(shè)備。當(dāng)自動檢測時，機器通過攝像頭自動掃描PCB，采集圖像，測試的焊點與數(shù)據(jù)庫中的合格的參數(shù)進行比較，經(jīng)過圖像處理，檢查出PCB上缺陷，并通過顯示器或自動標(biāo)志把缺陷顯示/標(biāo)示出來，供維修人員修整。
運用高速高精度視覺處理技術(shù)自動檢測PCB板上各種不同貼裝錯誤及焊接缺陷。PCB板的范圍可從細(xì)間距高密度板到低密度大尺寸板，并可提供在線檢測方案，以提高生產(chǎn)效率，及焊接質(zhì)量。通過使用AOI作為減少缺陷的工具，在裝配工藝過程的早期查找和消除錯誤，以實現(xiàn)良好的過程控制。早期發(fā)現(xiàn)缺陷將避免將壞板送到隨后的裝配階段，AOI將減少修理成本將避免報廢不可修理的電路板。

FrameScan電容藕合測試
FrameScan利用電容藕合探測管腳的脫開。每個器件上面有一個電容性探頭，在某個管腳激勵信號，電容性探頭拾取信號。如圖所示：
1 夾具上的多路開關(guān)板選擇某個器件上的電容性探頭。
2 測試儀內(nèi)的模擬測試板（ATB）依次向每個被測管腳發(fā)出交流信號。
3 電容性探頭采集并緩沖被測管腳上的交流信號。
4 ATB測量電容性探頭拾取的交流信號。如果某個管腳與電路板的連接是正確的，就會測到信號；如果該管腳脫開，則不會有信號。
GenRad類式的技術(shù)稱Open Xpress。原理類似。
此技術(shù)夾具需要傳感器和其他硬件，測試成本稍高。
邊界掃描技術(shù)
Boundary-Scan邊界掃描技術(shù)
ICT測試儀要求每一個電路節(jié)點至少有一個測試點。但隨著器件集成度增高，功能越來越強，封裝越來越小，SMT元件的增多，多層板的使用，PCB板元件密度的，要在每一個節(jié)點放一根探針變得很困難，為增加測試點，使制造費用增高；同時為開發(fā)一個功能強大器件的測試庫變得困難，開發(fā)周期延長。為此，聯(lián)合測試組織（JTAG）頒布了IEEE1149.1測試標(biāo)準(zhǔn)。
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